安徽开放大学《数字电子技术基础》终结性考试复习题库(附答案).docx
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1、安徽开放大学数字电子技术基础终结性考试复习题库(附答案)一、单选题1 .晶体管作为开关使用时,主要工作于。难度:一般A、截止区放大区B、截止区饱和区C、放大区饱和区D、饱和区答案:B2 .计数器是()。难度:容易A、时序逻辑器件B、组合逻辑器件C、定时器件Dv整形器件答案:A3 .时序逻辑电路一般可以分两类,即()。难度:容易A、组合逻辑电路和时序逻辑电路B、门电路和触发器C、同步型和异步型D、模拟电路和数字电路4 .晶体管工作在饱和区的条件是。难度:一般A、发射结正向偏置,集电结反向偏置B、发射结反向偏置,集电结正向偏置C、发射结正向偏置,集电结正向偏置D、发射结反向偏置,集电结反向偏置答案
2、:C5 .三极管工作在截止状态时其条件是。难度:困难A、发射结正向偏置,集电结反向偏置B、发射结电压小于其死区电压C、发射结集电结都正向偏置D、集电结电压大于其死区电压答案:B6 .利用三极管的截止状态和什么状态实现开关电路的断开和接通O。难度:容易A、放大状态B、击穿状态C、饱和状态D、导通状态答案:C7 .741.S138译码器有(),741.S148编码器有()。难度:容易A、三个输入端,三个输出端;Bv八个输入端,八个输出端;C、三个输入端,八个输出端;D、八个输入端,三个输出端。答案:A8 .边沿式D触发器是一种()稳态电路。难度:容易A、无B、单C、双D、多答案:C9 .半加器和的
3、输出端与输入端的逻辑关系是()。难度:容易A、与非B、或非C、与或非D、异或答案:D10 .无论是PNP型还是NPN型三极管,若工作在放大状态时其条件是。难度:困难A、发射结正向偏置,集电结反向偏置B、发射结集电结都反向偏置C、发射结集电结都正向偏置D、视管子类型而定答案:A11 .以下错误的是()。难度:一般A、数字比较器可以比较数字大小B、实现两个一位二进制数相加的电路叫全加器C、实现两个一位二进制数和来自低位的进位相加的电路叫全加器D、编码器可分为普通全加器和优先编码器答案:B12 .若在编码器中有50个编码对象,则要求输出二进制代码位数为()位。难度:容易A、5B、6C、10D、50答
4、案:B13 .下列描述不正确的是0。难度:容易A、译码器、数据选择器、EPROM均可用于实现组合逻辑函数。B、寄存器、存储器均可用于存储数据。C、将移位寄存器首尾相连可构成环形计数器D、上面描述至少有一个不正确答案:D14 .在四变量卡诺图中,逻辑上不相邻的一组最小项为:()o难度:困难Axml与m3Bxm4与m6Cxm5与m13Dxm2与m8答案:D15 .晶体管工作在截止状态时其条件是。难度:一般A、发射结正向偏置,集电结反向偏置B、发射结电压小于其死区电压或反向偏置C、发射结集电结都正向偏置D、集电结电压大于其死区电压答案:B16 .属于组合逻辑电路的部件是O。难度:容易Av编码器B、寄
5、存器C、触发器D、计数器答案:A17.输入100Hz脉冲信号,要获得10HZ的输出脉冲信号需要用多少进制计数器实现0。难度:容易A、100进制B、10进制Cx50进制D、5进制答案:B18 .二进制数IlOII转换为十进制数为()。难度:容易A、32B、27C、64Dv128答案:B19 .指出下列电路中能够把串行数据变成并行数据的电路应该是()。难度:困难A、JK触发器B、3/8线译码器C、移位寄存器D、十进制计数器答案:C20 .D触发器具有的特点。难度:容易Ax在时钟脉冲上升沿触发B、逻辑判断C、可以实现翻转计数D、输入与输出隔离答案:A21 .晶体管处于饱和状态时,它的集电结偏,发射结
6、偏。难度:一般Ax正/反B、反/正C、正/正D、反/反22 .TT1.与非门的多余脚悬空等效于O。难度:容易Av1BxOC、VccD、Vee答案:A23 .要将方波脉冲的周期扩展10倍,可采用()。难度:一般A、10级施密特触发器B、10位二进制计数器C、十进制计数器D、10位D/A转换器答案:C24 .8位移位寄存器,串行输入时经()个脉冲后,8位数码全部移入寄存器中。难度:容易Av1Bv2Cx4Dx8答案:D25 .测得某PNP型晶体管E极电位为0.4V,B极电位为1.2V,C极电位为15V,可判断出其工作状态为。难度:容易Bv饱和导通C、线性放大D、非线性放大答案:A26 .一位8421
7、BCD码计数器至少需要()个触发器。难度:容易A、3B、4C、5Dv10答案:B27 .金属导体的电阻率随温度升高而;半导体的导电能力随温度升高而。难度:一般Av升高/升高Bx降低/降低C、升高/降低Dv降低/升高答案:A28 .晶闸管一般是不容易坏的,最简单的判断是用万用表测间,看看有没有,如果没有,一般就可使用。难度:困难AxA短路B、AK;开路CxGK;短路DsAG;开路答案:A29 .当用专用输出结构的PA1.设计时序逻辑电路时,必须还要具备有()。难度:容易A、触发器B、晶体管C、 MOS管D、电容答案:A30 .同步计数器和异步计数器比较,同步计数器的显著优点是0。难度:容易A、工
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